xilinx 11.1怎样产生 IP CODE
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发布时间：2022-04-20 09:44
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时间：2023-07-12 03:58
在ISE中新建一个项目，然后菜单project，new source，选IP(core generator& architecture wizard)，填写file name，点下一步，在其中选择你要生成的核，finish。
然后ISE会开始生成核，弹出参数配置界面，根据你的需要一步步设好参数，最后点完成就生成了。有时比较慢，点完了得等一会儿才好。在project navigator里就能看到了。
需要注意的是，建立项目时选择的FPGA型号会决定IP核选择的列表，只会列出该型号FPGA能使用的IP核。
生成以后，选中ip核，在process里双击，view VHDL/Verilog model，可以看到生成的端口。然后在其它源文件里声明并例化就可以了。
